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为 fpga、asic 和 soc 设计数字信号处理应用

dsp hdl toolbox™ 为开发无线、雷达、音频和传感器处理等信号处理应用提供预验证且硬件就绪的 simulink^® 模块和子系统。其中包括与 matlab^® 和 simulink 对接的模板以及参考示例。

使用该工具箱，您可以对 dsp 算法的各种硬件架构进行建模、探索和仿真。ip 模块支持串行和并行处理的实现，让您可以探索资源使用、功耗和每秒千兆次采样 (gsps) 吞吐量性能之间的设计空间。

该工具箱的算法可让您生成可读、可综合的 vhdl^® 和 verilog^® 代码（需要 hdl coder™）。您还可以从使用这些算法的设计中生成 systemverilog dpi 验证组件（需要 hdl verifier™）。

从一系列经硬件验证的优化库模块中进行选择，以在硬件上实现 dsp 滤波器和变换。

通过简单地更改输入数据并行机制并指定支持的架构来探索速率为每秒千兆次采样 (gsps) 时的吞吐量选项。

使用内置的模块参数探索各种可配置串行和平行架构的设计权衡，例如功耗、吞吐量和资源使用。

建模、仿真和在 fpga 和 soc 上部署需要进行高速处理的雷达、无线和其他真实应用。

将经过硬件验证的模块与 hdl coder 结合使用，加快可在任意 fpga 平台上进行原型构建的应用的开发速度。

使用 hdl verifier，验证您生成的 hdl 能否在与 matlab 或 simulink test 环境连接并受支持的 eda 仿真器或 fpga 开发工具包上运行。

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